- 情報提供元:

株式会社ディジタルメディアプロフェッショナルの求人情報
- 掲載期間:
- 2026/03/23 ~2026/05/25
更新日:2026年02月16日
募集要項
- 募集職種
- ASIC設計エンジニア(AI/画像処理プロセッサ)
- 仕事内容
- 【職務概要】
半導体製品開発案件の増加に伴い、AI・画像処理プロセッサ向けASICのフロントエンド設計を担当します。
論理設計からSoC全体設計まで関わり、高性能・低消費電力なチップ開発を推進するポジションです。
【職務詳細】
■製品:AIプロセッサ、画像処理プロセッサ、SoC
■範囲:仕様検討~アーキテクチャ設計~論理設計
■開発:
Verilog、SystemVerilog、ASICフロントエンド
【具体的には】
・AI/画像処理プロセッサ向けハードウェアIPの論理設計
・高性能/低消費電力を意識した回路最適化
・複数IPを統合したSoCアーキテクチャ設計
・仕様設計、マイクロアーキテクチャ設計、論理設計の一連対応
・ソフトウェアチームや外部パートナーとの技術連携・調整
- 雇用形態
- 正社員(中途)
- 応募資格
- 【必須】
・RTLを用いたハードウェアIP設計、SoCアーキテクチャ設計、ASIC設計における7年以上の実務経験
・論理合成、タイミングクロージャ、PPA (Power, Performance, Area) 最適化に関する知識と実務経験
・検証効率化のためのC言語, C++, Python, シェルスクリプトなどの簡単なソフトウェアプログラミングの実務経験
【尚可】
・AI, GPU、画像処理、ビデオデコーダなどの大量の演算の高速処理を要する先端SoCの開発経験
・アルゴリズムの高速処理を目的としたハードウェアIPの開発経験
・インターコネクト、バスアーキテクチャについての知識や経験
- 勤務地
- 東京都中野区中野四丁目10番2号 中野セントラルパークサウス16階
- 勤務時間
- 始業9時00分、終業18時00分を基本とし、労働者の決定に委ねる ※9時間勤務したものとみなす
- 想定給与
- 経験、スキル、年齢を考慮の上、同社規定により優遇
- 待遇・福利厚生
- 確定拠出年金、関東ITソフトウェア健康保険組合、ベネフィット・ステーション(eラーニング800コース超/映画・旅行等の各種割引等)、従業員持株会(奨励金20%)、社内同好会補助制度、書籍購入補助制度、ランチ補助制度(等級条件あり)、表彰制度等
- 休日・休暇
- 完全週休2日制(土・日)、祝日、年末年始休暇、夏期休暇(3日)、有給休暇(初年度は入社時期により付与日数変動)、産前産後休暇、慶弔休暇
会社概要
- 社名
- 株式会社ディジタルメディアプロフェッショナル
- 資本金
- 18億3888万2500 (2021年06月18日時点)円
- 従業員数
- 67名(連結)
- 事業内容
- ■GPUおよびAI関連のIPコアライセンス■半導体・モジュール等製品の開発、販売■GPUおよびAI関連のプロフェッショナルサービスの提供
- 住所
- 1640001 中野区中野四丁目10番2号 中野セントラルパークサウス16階
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■経験、スキル、年齢を考慮の上、同社規定により優遇
