掲載期間
2020/08/01 ~2020/10/03

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株式会社エッチ・ディー・ラボ

情報提供元:株式会社ワークポート

半導体設計エンジニア

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募集要項

半導体設計エンジニア

募集職種
半導体設計エンジニア
仕事内容
【職務概要】
半導体設計エンジニアを担当していただきます。

【職務詳細】
VHDL、Verilog-HDL、System Verilog、SystemCによる、
ロジック回路設計を主にお任せします。
ハイレベルな設計を手がけていただくことが多くなります。

また、SystemCに関する技術提供、新たな設計環境構築、設計を
効率化するための手法を開発する設計・検証コンサルティングに
携わっていただくことも可能です。

ロジック回路設計からスタートするもよし、
最初からコンサルティングに携わるもよし。
あなたの希望と実力に応じて、選択していただけます。

【ハイレベルな設計に携われるワケ】
トレーニング、講演会などを通じて、多くの大手半導体メーカーや
機器メーカーに技術提供する同社。これらの実績が高く評価され、
設計も手がけてほしいというオファーが絶えませんでした。
そこで、実際に設計も行なうように。代表取締役の実績から、
抽象度の高いハイレベルな設計をお願いされることが多くあります。
雇用形態
正社員(中途)
応募資格
【必須】
・VHDL、Verilog-HDLによるロジック回路設計の経験

【尚可】
・SystemCへの興味

《毎月1回は勉強会を実施》
技術ノウハウの共有を目的として、全員で勉強会を行なっています。
現在は、SystemCの設計手法に関する勉強会が主流です。
講師役となるのはメンバー全員。順番を決め、当番制で行なっています。

《社外セミナーへの参加を奨励》
他社が主催する技術トレーニングなどのセミナーへの参加を奨励しています。
また、海外研修に参加する機会も用意しています。
勤務地
【関東】神奈川県 横浜市港北区
勤務時間
フレックスタイム制(標準労働時間7時間)
※コアタイム10時00分~15時00分
想定給与
■経験、スキル、年齢を考慮の上、同社規定により優遇
待遇・福利厚生
交通費全額支給、出張手当、海外研修制度、退職金制度、社員持株制度、保養所
休日・休暇
年間休日128日、完全週休2日制(土・日)、祝日、夏季、年末年始、有給(初年度12日)、慶弔、代休

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会社概要

半導体設計エンジニア

社名
株式会社エッチ・ディー・ラボ
資本金
3,780万円
従業員数
22名
事業内容
・通信、画像処理に関するHDL設計、LSI・FPGA設計、コンサルティング・IP開発、LSI・FPGA設計トレーニング
住所
2220033   神奈川県 横浜市港北区新横浜3-17-6 イノテックビル10F

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